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Verification Engineer (m/f)
Eingestellt von Hays aus Mannheim, Universitätsstadt
Gesuchte Skills: Engineer
Projektbeschreibung
334036/1
IHRE AUFGABEN:
-Digital SOC Verification for an ASIC Chip project
IHRE QUALIFIKATIONEN:
-Verification with Specman (UVM) with E language
-Verification of SOCs
-Development of Test-benches
-Knowledge of verrification techniques like constraint-random, assertion-based, formal, UVM, SystemVerilog, E
-Experience with EDA Tools
-Experience with Candence „Specman“
WEITERE QUALIFIKATIONEN:
Hardware developer
Projektdetails
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Einsatzort:
München, Deutschland
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Projektbeginn:
asap
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Projektdauer:
9 MM
- Vertragsart:
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Berufserfahrung:
Keine Angabe
Geforderte Qualifikationen
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Kategorie:
Ingenieurwesen/Technik
Hays
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Straße:
Willy-Brandt-Platz 1-3
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Ort:
68161 Mannheim, Universitätsstadt, Deutschland