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ASIC Designer zur Entwicklung von Testbenches (m/w)
Eingestellt von Hays aus Mannheim, Universitätsstadt
Gesuchte Skills: Designer
Projektbeschreibung
340362/12
IHRE AUFGABEN:
-Erstellung von Testbenches für einen Mixed Signal Chip mit Verilog
-Durchführung von Systemsimulationen
-Modellierung analoger Funktionen mit Verilog
IHRE QUALIFIKATIONEN:
-Fundierte Projekterfahrung im Umgang mit Verilog
-Sehr gute Kenntnisse in der Erstellung von Testbenches
-Profunde Erfahrung im Bereich digitale Funktionen (idealerweise auch analoge Funktionen)
WEITERE QUALIFIKATIONEN:
Hardwareentwickler
Projektdetails
- Einsatzort:
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Projektbeginn:
asap
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Projektdauer:
5 MM+
- Vertragsart:
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Berufserfahrung:
Keine Angabe
Geforderte Qualifikationen
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Kategorie:
Medien/Design
Hays
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Straße:
Willy-Brandt-Platz 1-3
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Ort:
68161 Mannheim, Universitätsstadt, Deutschland