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Analog Layouter (m/f)

Eingestellt von Hays aus Mannheim, Universitätsstadt

Gesuchte Skills: Design, Ip

Projektbeschreibung

REFERENZNUMMER:

340525/15

IHRE AUFGABEN:

-Custom layout design for advanced node test chip development
-Layout of complex memory IP for process development
-Bottom-up layout based on custom design schematics
-Schematic driven layout of assigned circuits with the Cadence Virtuoso tool suite
-Completion of the layout using LVS and DRC including colouring and fill
-Handling layout revision caused by post-layout iterations with design as well as technology changes (Booleans, design rules, PDK)

IHRE QUALIFIKATIONEN:

-Familiarity with the Cadence Virtuoso tool suite
-Experience in Mentor Calibre LVS and DRC tools
-Know-how regarding advanced node CMOS technologies (equal or less than 40nm)

WEITERE QUALIFIKATIONEN:

Hardware developer

Projektdetails

  • Einsatzort:

    Saxony, Deutschland

  • Projektbeginn:

    asap

  • Projektdauer:

    3 MM

  • Vertragsart:

    Contract

  • Berufserfahrung:

    Keine Angabe

Geforderte Qualifikationen

  • Kategorie:

    IT Entwicklung, Medien/Design

  • Skills:

    design, ip

Hays

  • Straße:

    Willy-Brandt-Platz 1-3

  • Ort:

    68161 Mannheim, Universitätsstadt, Deutschland

  • Projekte:

    1.413 Projekte Alle anzeigen